基于OR1200的嵌入式SoC以太網(wǎng)網(wǎng)關(guān)的研究與設(shè)計(jì)
發(fā)布時(shí)間:2021-10-26 01:01
高性能的處理器核是嵌入式系統(tǒng)中最為關(guān)鍵和核心的部分。目前在嵌入式系統(tǒng)設(shè)計(jì)中廣泛使用的32位RISC處理器,如ARM公司的ARM處理器,IBM的Power PC處理器,MIPS公司的MIPS處理器等均屬于商業(yè)內(nèi)核,使用者必須支付相對(duì)昂貴的授權(quán)費(fèi)。OR1200以其完全開(kāi)放的源代碼和編譯器吸引了設(shè)計(jì)者,其結(jié)構(gòu)簡(jiǎn)單、通用性和可移植性強(qiáng),具備完整的開(kāi)發(fā)平臺(tái),非常適合于嵌入式系統(tǒng)設(shè)計(jì)。關(guān)于OR1200的研究也正受到了學(xué)術(shù)界和工業(yè)界越來(lái)越多的關(guān)注。本文就是在此背景下結(jié)合導(dǎo)師承擔(dān)的青島市科技局科技計(jì)劃項(xiàng)目來(lái)研究實(shí)現(xiàn)一種基于開(kāi)源微處理器的嵌入式SOC網(wǎng)關(guān)芯片。本文對(duì)OR1200和其它一些wishbone總線接口的外圍IP軟核進(jìn)行FPGA設(shè)計(jì)與驗(yàn)證,實(shí)現(xiàn)嵌入式SoC網(wǎng)關(guān)集成電路前端系統(tǒng)設(shè)計(jì),構(gòu)建OR1200的SoC硬件平臺(tái)。在OR1200的SoC硬件平臺(tái)的基礎(chǔ)上移植嵌入式實(shí)時(shí)操作系添加網(wǎng)絡(luò)支持,最終是要實(shí)現(xiàn)一個(gè)嵌入式SOC網(wǎng)關(guān)芯片。操作系統(tǒng)選擇uC/OS-Ⅱ?qū)崟r(shí)操作系統(tǒng)。網(wǎng)絡(luò)協(xié)議棧選用一種輕型的嵌入式以太網(wǎng)協(xié)議棧LWIP。本系統(tǒng)實(shí)現(xiàn)FPGA時(shí),頻率可達(dá)到20MHz,具有穩(wěn)定的網(wǎng)絡(luò)功能。該系統(tǒng)在FPGA芯片...
【文章來(lái)源】:山東科技大學(xué)山東省
【文章頁(yè)數(shù)】:81 頁(yè)
【學(xué)位級(jí)別】:碩士
【部分圖文】:
OR12OOIP核的功能仿真波形圖
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圖3.13存儲(chǔ)控制器功能仿真波形圖Fig.3.13Memoryeontroller’sFunetionalsimulation存儲(chǔ)控制器IP核經(jīng)適配之后的FPGA資源使用情況如圖3.14所示:該IP核占用邏輯單元1915個(gè),:片芯片資源的3%,此外還占用1059個(gè)寄存器。FitterStatu:Su。。。::D且一朋onM叮2419二25:122010Quartu:11Vor:ion9.0Build23506/17/2009Sr2SJF公1Vor:ionRevi三1onN抑emc_topTop一levelEntity耳艦.emc_topF鉚11獷Cyolon。工工DevieeEP2C70F896C6TimingMode15FirL丑Tot丑logieelomerLt:1』915/68滬416(3%〕Tot丑coob、rLat:·。。丑D汀LCt:l:ln:1,已44/68,426(2%)De·生:!畉o.11::l91:r。:i:ter:1,059/68,416〔2%)Tot丑re‘1:ter:1059Tot且pi。:26了尹622(43%)Tot丑virtu吐pl幾三O
【參考文獻(xiàn)】:
期刊論文
[1]基于μC/OS-Ⅱ的嵌入式以太網(wǎng)接口的設(shè)計(jì)與實(shí)現(xiàn)[J]. 陳麗雪,吳志紅,羅強(qiáng). 四川大學(xué)學(xué)報(bào)(自然科學(xué)版). 2008(04)
[2]基于SoPC的嵌入式系統(tǒng)設(shè)計(jì)技術(shù)[J]. 李鍵,李鵬,張磊. 航空計(jì)算技術(shù). 2008(02)
[3]基于U-boot構(gòu)建嵌入式Linux的Bootloader[J]. 劉磊,張鳳荔,秦志光. 計(jì)算機(jī)應(yīng)用研究. 2007(12)
[4]32位軟核處理器NIOS II的以太網(wǎng)接口設(shè)計(jì)與實(shí)現(xiàn)[J]. 陳小毛,陳尚松. 電子測(cè)量技術(shù). 2007(01)
[5]在OpenRISC中實(shí)現(xiàn)CRC32并行計(jì)算[J]. 朱立標(biāo),邱智亮. 電子科技. 2006(09)
[6]嵌入式CPU軟核綜述[J]. 孫愷,王田苗,魏洪興,陳友東. 計(jì)算機(jī)工程. 2006(07)
[7]基于μCOS-Ⅱ的嵌入式系統(tǒng)以太網(wǎng)通信功能的實(shí)現(xiàn)[J]. 何軒,夏應(yīng)清,李祥,付曉軍. 電子科技. 2005(12)
[8]開(kāi)放性32位RISC處理器IP核的比較與分析[J]. 劉軍,郭立,鄭東飛,白雪飛. 電子器件. 2005(04)
[9]Hardware-Software Co-Simulation for SOC Functional Verification[J]. 嚴(yán)迎建,劉明業(yè). Journal of Beijing Institute of Technology(English Edition). 2005(02)
[10]基于OR1200的嵌入式SoPC硬件平臺(tái)設(shè)計(jì)[J]. 孫愷,魏洪興,陳友東. 電子技術(shù)應(yīng)用. 2005(06)
碩士論文
[1]基于μC/OS-II的嵌入式以太網(wǎng)網(wǎng)關(guān)在ARM7的實(shí)現(xiàn)研究[D]. 何玨.上海交通大學(xué) 2007
本文編號(hào):3458514
【文章來(lái)源】:山東科技大學(xué)山東省
【文章頁(yè)數(shù)】:81 頁(yè)
【學(xué)位級(jí)別】:碩士
【部分圖文】:
OR12OOIP核的功能仿真波形圖
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圖3.13存儲(chǔ)控制器功能仿真波形圖Fig.3.13Memoryeontroller’sFunetionalsimulation存儲(chǔ)控制器IP核經(jīng)適配之后的FPGA資源使用情況如圖3.14所示:該IP核占用邏輯單元1915個(gè),:片芯片資源的3%,此外還占用1059個(gè)寄存器。FitterStatu:Su。。。::D且一朋onM叮2419二25:122010Quartu:11Vor:ion9.0Build23506/17/2009Sr2SJF公1Vor:ionRevi三1onN抑emc_topTop一levelEntity耳艦.emc_topF鉚11獷Cyolon。工工DevieeEP2C70F896C6TimingMode15FirL丑Tot丑logieelomerLt:1』915/68滬416(3%〕Tot丑coob、rLat:·。。丑D汀LCt:l:ln:1,已44/68,426(2%)De·生:!畉o.11::l91:r。:i:ter:1,059/68,416〔2%)Tot丑re‘1:ter:1059Tot且pi。:26了尹622(43%)Tot丑virtu吐pl幾三O
【參考文獻(xiàn)】:
期刊論文
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[6]嵌入式CPU軟核綜述[J]. 孫愷,王田苗,魏洪興,陳友東. 計(jì)算機(jī)工程. 2006(07)
[7]基于μCOS-Ⅱ的嵌入式系統(tǒng)以太網(wǎng)通信功能的實(shí)現(xiàn)[J]. 何軒,夏應(yīng)清,李祥,付曉軍. 電子科技. 2005(12)
[8]開(kāi)放性32位RISC處理器IP核的比較與分析[J]. 劉軍,郭立,鄭東飛,白雪飛. 電子器件. 2005(04)
[9]Hardware-Software Co-Simulation for SOC Functional Verification[J]. 嚴(yán)迎建,劉明業(yè). Journal of Beijing Institute of Technology(English Edition). 2005(02)
[10]基于OR1200的嵌入式SoPC硬件平臺(tái)設(shè)計(jì)[J]. 孫愷,魏洪興,陳友東. 電子技術(shù)應(yīng)用. 2005(06)
碩士論文
[1]基于μC/OS-II的嵌入式以太網(wǎng)網(wǎng)關(guān)在ARM7的實(shí)現(xiàn)研究[D]. 何玨.上海交通大學(xué) 2007
本文編號(hào):3458514
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