本文選題：數(shù)字射頻存儲(chǔ) + 數(shù)模轉(zhuǎn)換��； 參考：《燕山大學(xué)》2016年碩士論文

【摘要】：隨著電子對(duì)抗技術(shù)的不斷發(fā)展,高速數(shù)字射頻存儲(chǔ)技術(shù)逐漸被人們運(yùn)用到雷達(dá)系統(tǒng)中。數(shù)字射頻存儲(chǔ)系統(tǒng)通過對(duì)射頻信號(hào)的采集、存儲(chǔ)、變換重構(gòu),來實(shí)現(xiàn)對(duì)信號(hào)目標(biāo)的模擬、回放、干擾等。近年來,隨著高速集成電路的不斷發(fā)展,雷達(dá)系統(tǒng)的發(fā)展也得到了進(jìn)一步的提高。然而,數(shù)字射頻存儲(chǔ)系統(tǒng)的帶寬和轉(zhuǎn)換速率都限制了雷達(dá)系統(tǒng)的發(fā)展。針對(duì)以上問題,本文在數(shù)字射頻存儲(chǔ)系統(tǒng)中運(yùn)用高速數(shù)模轉(zhuǎn)換電路,從而使得系統(tǒng)在速度和帶寬方面取得突破性進(jìn)展。首先,本文根據(jù)系統(tǒng)提出的各項(xiàng)技術(shù)指標(biāo),對(duì)芯片進(jìn)行選型。同時(shí),對(duì)系統(tǒng)內(nèi)的現(xiàn)場(chǎng)可編程門陣列(Field Programmable Gate Array,FPGA)模塊、數(shù)據(jù)轉(zhuǎn)換模塊、時(shí)鐘模塊、電源管理模塊、電平轉(zhuǎn)換模塊進(jìn)行詳細(xì)設(shè)計(jì)及可行性分析�；谠韴D的設(shè)計(jì)進(jìn)行PCB繪制。針對(duì)高速DAC模塊及數(shù)字射頻存儲(chǔ)系統(tǒng)的特點(diǎn),提出了繪制PCB過程中需要注意的一系列問題,包括疊層、信號(hào)完整性、電源完整性、布局布線等幾方面。繪制完成后,進(jìn)行電路板的制作。其次,對(duì)數(shù)字射頻存儲(chǔ)系統(tǒng)進(jìn)行邏輯設(shè)計(jì)。實(shí)現(xiàn)的主要功能是通過直接數(shù)字頻率合成技術(shù)在FPGA內(nèi)部產(chǎn)生頻率可控的數(shù)字信號(hào),對(duì)數(shù)字信號(hào)產(chǎn)生模塊進(jìn)行時(shí)域和頻域的仿真。對(duì)系統(tǒng)數(shù)據(jù)的邏輯轉(zhuǎn)換進(jìn)行設(shè)計(jì),通過FPGA內(nèi)的并串轉(zhuǎn)換將數(shù)據(jù)進(jìn)行升速處理,為系統(tǒng)提供數(shù)字信號(hào)。對(duì)數(shù)字射頻存儲(chǔ)系統(tǒng)的時(shí)鐘邏輯進(jìn)行設(shè)計(jì)及仿真。最后,對(duì)系統(tǒng)進(jìn)行上板調(diào)試。對(duì)系統(tǒng)的窗口、無雜散動(dòng)態(tài)范圍、平坦度等重要參數(shù)進(jìn)行了測(cè)試。通過測(cè)試結(jié)果可以看出系統(tǒng)的設(shè)計(jì)完成了預(yù)定目標(biāo),實(shí)現(xiàn)了高速數(shù)字射頻存儲(chǔ)系統(tǒng)中DA模塊8GSPS轉(zhuǎn)換速率,4GHz帶寬,30dBc以上的無雜散動(dòng)態(tài)范圍,各項(xiàng)技術(shù)指標(biāo)性能良好。
[Abstract]:With the continuous development of electronic countermeasures technology, high speed digital radio frequency storage technology is gradually applied to radar system. Digital radio frequency storage system is used to collect, store, transform and reconstruct radio frequency signal to realize signal target simulation, playback, interference and so on. In recent years, with the continuous development of high speed integrated circuit, radar system However, the bandwidth and conversion rate of the digital radio frequency storage system restrict the development of the radar system. In this paper, the high-speed digital analog conversion circuit is used in the digital radio frequency storage system, which makes the system achieve breakthrough in speed and band width. At the same time, the detailed design and feasibility analysis of the field programmable gate array (Field Programmable Gate Array, FPGA) module, the data conversion module, the clock module, the power management module, the level conversion module, and the PCB drawing based on the design of the schematic diagram. The characteristics of high speed DAC module and digital radio frequency storage system, a series of problems should be paid attention to in the process of drawing PCB, including stack, signal integrity, power integrity, layout and wiring. After drawing and completion, the circuit board is made. Secondly, the logic design of the digital radio frequency storage system is made. The main functions of the realization are the main functions of the system. Using direct digital frequency synthesis technology to generate frequency controlled digital signals within FPGA, the digital signal generation module is simulated in the time domain and frequency domain. The logic conversion of the system data is designed, the data is processed by the parallel serial conversion in FPGA, and the digital signal is provided for the system. The clock logic is designed and simulated. Finally, the system is debugged on board. The system window, no stray dynamic range, flatness and other important parameters are tested. Through the test results, it can be seen that the system design completed the predetermined target, and realized the DA module 8GSPS conversion rate, 4GHz bandwidth, 30d in the high speed digital radio frequency storage system. The Bc has no spurious dynamic range, and the technical indexes are in good performance.

【學(xué)位授予單位】：燕山大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2016
【分類號(hào)】：TN952

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本文編號(hào)：1820963