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SoC系統(tǒng)中高速I/O系統(tǒng)的實(shí)現(xiàn)與驗(yàn)證

發(fā)布時(shí)間:2021-04-19 09:23
  隨著現(xiàn)代科技與電子產(chǎn)品的日新月異,更快的速率、更高的帶寬已經(jīng)成為業(yè)界追求的目標(biāo)之一。PCIe3.0協(xié)議在此背景下應(yīng)運(yùn)而生,通過PCIe3.0協(xié)議設(shè)計(jì)出的相關(guān)產(chǎn)品在工作和生活中也越來越常見。目前,PCIe3.0已經(jīng)成為處理器性能提高的重要因素之一。本文首先介紹了PCIe總線的發(fā)展和應(yīng)用,然后分析了PCIe總線的協(xié)議內(nèi)容,并總結(jié)了PCIe3.0獨(dú)有的特點(diǎn)。通過PCIe3.0的IP核復(fù)用技術(shù)和AMBA3.0總線架構(gòu),實(shí)現(xiàn)了一款So C芯片中的高速I/O系統(tǒng)。該系統(tǒng)實(shí)現(xiàn)了PCIe3.0協(xié)議中的RC設(shè)備和EP設(shè)備,以及二者之間的連接。通過RC設(shè)備中的Host轉(zhuǎn)接橋完成對不同設(shè)備空間的訪問,通過EP設(shè)備發(fā)起DMA請求和中斷請求。本文搭建了Verilog語言的定向測試平臺,對RC設(shè)備和EP設(shè)備進(jìn)行配置,完成鏈路訓(xùn)練和初始化過程,使二者可以進(jìn)行TLP報(bào)文傳輸,然后對設(shè)計(jì)的功能點(diǎn)進(jìn)行驗(yàn)證,并使用了Systemverilog語言的UVM平臺,建立隨機(jī)化測試激勵(lì),其中采用了OVL斷言檢查器,檢查設(shè)計(jì)內(nèi)部不同類型的PCIe3.0協(xié)議TLP報(bào)文和鏈路中的關(guān)鍵信號。 

【文章來源】:國防科技大學(xué)湖南省 211工程院校 985工程院校

【文章頁數(shù)】:86 頁

【學(xué)位級別】:碩士

【部分圖文】:

SoC系統(tǒng)中高速I/O系統(tǒng)的實(shí)現(xiàn)與驗(yàn)證


AXI寫數(shù)據(jù)波形圖

波形圖,讀數(shù),波形圖,信號


圖 5.2 AXI 讀數(shù)據(jù)波形圖3. Apb 接口和 phy 接口的驗(yàn)證:圖 5.3 為經(jīng)過 RC 設(shè)備的 AXI 主接口,對 PHY 寄存器空間讀寫訪問的波形圖,對于寫訪問,在 APB 接口處,首先 pselx 信號和 pwrite 信號與寫地址和寫數(shù)據(jù)信號對齊,表示一個(gè) APB 寫請求,下一個(gè)時(shí)鐘周期,penable 信號為 1,當(dāng) pready 信號為 1 時(shí),表示寫地址和寫數(shù)據(jù)成功寫入;在 phy 接口,寫地址信號依照地址轉(zhuǎn)換規(guī)則,轉(zhuǎn)換成 pcs_lane_sel,pcs_mmd_addr,pcs_reg_addr 共 3 個(gè)信號,pcs_reg_wr信號為 1,成功把數(shù)據(jù)寫入 PHY 寄存器,寫訪問完成;對于讀訪問,在 APB 接口處,首先 pselx 信號和 pwrite 信號與讀地址信號對齊,pwrtie 信號為 0,表示一個(gè)APB 讀請求,下一個(gè)時(shí)鐘周期,penable 信號為 1,等待 pready 信號,在 phy 接口,讀地址轉(zhuǎn)換成 pcs_lane_sel,pcs_mmd_addr,pcs_reg_addr 共 3 個(gè)信號,pcs_reg_rd信號為 1,表示讀取 phy 寄存器,當(dāng) rd_ack 信號為 1 時(shí),讀取 phy 寄存器的數(shù)據(jù),將讀響應(yīng)信號與讀數(shù)據(jù)信號傳給 apb 接口,pready 信號為 1,成功讀取 phy 寄存器的數(shù)據(jù),讀訪問完成。

波形圖,波形圖,信號,寄存器


圖 5.2 AXI 讀數(shù)據(jù)波形圖3. Apb 接口和 phy 接口的驗(yàn)證:圖 5.3 為經(jīng)過 RC 設(shè)備的 AXI 主接口,對 PHY 寄存器空間讀寫訪問的波形圖,對于寫訪問,在 APB 接口處,首先 pselx 信號和 pwrite 信號與寫地址和寫數(shù)據(jù)信號對齊,表示一個(gè) APB 寫請求,下一個(gè)時(shí)鐘周期,penable 信號為 1,當(dāng) pready 信號為 1 時(shí),表示寫地址和寫數(shù)據(jù)成功寫入;在 phy 接口,寫地址信號依照地址轉(zhuǎn)換規(guī)則,轉(zhuǎn)換成 pcs_lane_sel,pcs_mmd_addr,pcs_reg_addr 共 3 個(gè)信號,pcs_reg_wr信號為 1,成功把數(shù)據(jù)寫入 PHY 寄存器,寫訪問完成;對于讀訪問,在 APB 接口處,首先 pselx 信號和 pwrite 信號與讀地址信號對齊,pwrtie 信號為 0,表示一個(gè)APB 讀請求,下一個(gè)時(shí)鐘周期,penable 信號為 1,等待 pready 信號,在 phy 接口,讀地址轉(zhuǎn)換成 pcs_lane_sel,pcs_mmd_addr,pcs_reg_addr 共 3 個(gè)信號,pcs_reg_rd信號為 1,表示讀取 phy 寄存器,當(dāng) rd_ack 信號為 1 時(shí),讀取 phy 寄存器的數(shù)據(jù),將讀響應(yīng)信號與讀數(shù)據(jù)信號傳給 apb 接口,pready 信號為 1,成功讀取 phy 寄存器的數(shù)據(jù),讀訪問完成。

【參考文獻(xiàn)】:
期刊論文
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本文編號:3147283

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