發(fā)布時間：2020-06-14 00:00

【摘要】： 中央處理器是驅(qū)動計算機技術(shù)和產(chǎn)業(yè)發(fā)展的動力,CPU的設(shè)計和制造技術(shù)是計算機產(chǎn)業(yè)乃至信息技術(shù)產(chǎn)業(yè)發(fā)展的基礎(chǔ)。進行CPU相關(guān)的設(shè)計研發(fā)工作有著重大的學(xué)術(shù)意義和現(xiàn)實意義。而流水線技術(shù)是現(xiàn)代CPU設(shè)計的核心技術(shù),是決定CPU運行效率的關(guān)鍵因素。 RISC是上世紀80年代發(fā)展起來的處理器設(shè)計新技術(shù),它的出現(xiàn)對整個計算機界產(chǎn)生了深遠的影響。RISC體系結(jié)構(gòu)的重要特點是其便于利用流水線結(jié)構(gòu)進行指令操作。MIPS是一個優(yōu)秀的RISC版本,它的許多設(shè)計特點尤其適合流水線技術(shù)的運用,是一個非常適合CPU流水線設(shè)計的架構(gòu)平臺。 MIPS流水線的設(shè)計目標是要達到平均每個時鐘周期完成一條指令,這就是流水線的極限速度。但由于流水線中指令相關(guān)等問題的存在,常常使流水線發(fā)生阻塞延遲,使得指令不能夠在預(yù)定的時刻完成,因而無法達到極限速度的目標,更無法超越該速度。 為了進一步提高流水線的執(zhí)行效率,超越流水線的極限速度,本文在對現(xiàn)有32位MIPS流水線進行研究的基礎(chǔ)上,創(chuàng)新性地提出了基于32位MIPS架構(gòu)的雙發(fā)射流水線設(shè)計方案。運用該方案設(shè)計的流水線可以做到每時鐘周期同時并行發(fā)射兩條獨立指令,同時執(zhí)行。這樣,可以使流水線的極限速度變?yōu)槠骄恐芷谕瓿蓛蓷l指令,大幅提升了現(xiàn)有32位MIPS流水線的執(zhí)行效率。 本文的主要工作內(nèi)容如下: (1)對32位MIPS處理器的系統(tǒng)結(jié)構(gòu)和MIPS現(xiàn)有的五級流水線結(jié)構(gòu)進行分析,得出了MIPS流水線執(zhí)行效率的瓶頸因素,并分析了進一步提高現(xiàn)有MIPS流水線執(zhí)行效率的可行性。 (2)對基于32位MIPS架構(gòu)雙發(fā)射流水線的指令發(fā)射策略、控制相關(guān)處理和數(shù)據(jù)相關(guān)處理等流水線結(jié)構(gòu)的重要問題進行深入研究,并得出了靜態(tài)發(fā)射、優(yōu)化編譯指令序、第一流水線無延遲分支處理和雙流水線四通道前向數(shù)據(jù)通路等一系列能夠與32位MIPS架構(gòu)相匹配的雙發(fā)射流 【學(xué)位授予單位】：電子科技大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2006
【分類號】：TP332;TP311.52

【圖文】：

電子科技大學(xué)碩士學(xué)位論文=32'b0;=PC;NTROL_IF<={IADDRERROREXC,IADDRFILLEXC};delay)=MEMINST;=32'b0;NTROL_IF<=2'b0;-1 所示。

圖 3-2 分支判斷信號分支轉(zhuǎn)移指令需要如下的控制信號：（1）BRANCH�？刂菩盘� BRANCH 表示當前指令為跳轉(zhuǎn)指令或者分支指令。（2）J。控制信號 J 表示當前指令為跳轉(zhuǎn)指令。分支轉(zhuǎn)移指令控制信號設(shè)置如下：always @(jINST or beqINST or RSEQRT or bneINST or bltzINST or RSLTZ or blezINSTor RSEQZ or bgtzINST or RSEQZ or RSLTZ or bgezINST)beginBRANCH<=jINST||(beqINST&&RSEQRT)||(bneINST&&!RSEQRT)||(bltzINST&&RSLTZ)||(blezINST&&RSEQZ)||(bgtzINST&&!(RSEQZ||RSLTZ))||(bgezINST&&!RSLTZ);J<=jINST;end

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本文編號：2711946