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基于FPGA的MIPI-DSI發(fā)送接口設(shè)計與實現(xiàn)

發(fā)布時間:2020-05-15 20:35
【摘要】:隨著移動電子設(shè)備的娛樂功能日漸強大,為提升顯示效果,其搭載的顯示屏分辨率也越來越高,如今1080P的手機已成為市場主流,4K手機也已有公司試水。顯示屏分辨率的提升帶來的挑戰(zhàn)是圖像數(shù)據(jù)傳輸速率的爆炸式增長,傳統(tǒng)的視頻顯示接口已不再適用。MIPI-DSI是MIPI聯(lián)盟針對移動設(shè)備制定的串行數(shù)字圖像顯示接口協(xié)議,由于其高速和低功耗的特性,在現(xiàn)今的移動產(chǎn)業(yè)具有廣泛的應(yīng)用。在此背景下,本文設(shè)計并實現(xiàn)了一種基于FPGA的MIPI-DSI發(fā)送接口電路,傳輸速率可達(dá)500Mbps。本文首先簡要介紹了MIPI-DSI協(xié)議的內(nèi)容,以及與其密切相關(guān)的MIPI-DCS命令集和MIPI-DPHY物理層標(biāo)準(zhǔn);然后詳細(xì)介紹了發(fā)送接口的電路設(shè)計,其按照協(xié)議的結(jié)構(gòu)層次劃分為物理層、通道管理層、協(xié)議層和應(yīng)用層四個功能模塊,其中物理層由模擬電路和邏輯電路兩部分組成,其余模塊均由邏輯電路實現(xiàn),采用Verilog語言設(shè)計;之后基于HyperLynx平臺對模擬電路進行了仿真,以驗證其電氣特性是否符合MIPI協(xié)議,同時基于Modelsim平臺對邏輯電路進行了功能仿真,以驗證各個模塊的邏輯功能;最后設(shè)計并搭建了測試電路,對接口的性能及功能進行了測試。仿真和測試結(jié)果表明,發(fā)送接口電路的輸出信號符合MIPI協(xié)議的電氣規(guī)范,并且可以在500Mbps的數(shù)據(jù)速率下驅(qū)動外圍顯示模塊顯示動態(tài)圖像,實現(xiàn)了MIPI-DSI視頻傳輸功能。
【圖文】:

通道結(jié)構(gòu)


于傳輸高速數(shù)據(jù)的高速信號線和用于傳輸控制選的低功耗逃逸模式(Low-Power Escape Mod速數(shù)據(jù)通信采用突發(fā)模式,,可以傳輸任意長度由兩根線組成。因此,最簡單的 DPHY 配置只輸?shù)蛪翰畹牟罘中盘,且在發(fā)送端和接收端都,線路上傳輸單端信號,無需阻抗匹配。高速送器、接收器和傳輸線路的性能決定,DPHY束,大部分應(yīng)用場合的單通道傳輸速率在 80 到,增加數(shù)據(jù)通道可以提高 DPHY 的傳輸速率。0Mbps。由一個或多個高速單元、一個或多個低功耗單時驅(qū)動兩條線路傳輸差分信號,低功耗單元則號?刂七壿嬰娐坟(fù)責(zé)與上層協(xié)議通信,根據(jù)指的具有所有功能的 DPHY 通道(數(shù)據(jù)或時鐘)

框圖,模塊,框圖,參數(shù)


13圖 3- 2 發(fā)送接口頂層模塊框圖表 3- 4 發(fā)送接口頂層邏輯模塊端口功能描述類型 功能描述LK_FREQ 參數(shù) 像素時鐘頻率_CLK_FREQ 參數(shù) 字節(jié)時鐘頻率(=數(shù)據(jù)速率/串化因子K_DIV 參數(shù) 低速時鐘除數(shù)(=BYTE_CLK/LP_CL參數(shù) 顯示分辨率(行)參數(shù) 顯示分辨率(列)_WIDTH 參數(shù) 像素數(shù)據(jù)寬度
【學(xué)位授予單位】:華中科技大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2019
【分類號】:TN791;TP334.7

【參考文獻】

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3 蘇曉峰;基于MIPI規(guī)范的LCD驅(qū)動接口設(shè)計[D];華南理工大學(xué);2011年



本文編號:2665599

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