基于UPF的低功耗處理器設(shè)計(jì)研究
【圖文】:
第三章 低功耗 AO486 處理器系統(tǒng)設(shè)計(jì)研究3.1 AO486 處理器低功耗設(shè)計(jì)內(nèi)容論文研究中對開源 AO486 處理器系統(tǒng)展開低功耗設(shè)計(jì)研究,,包括引入多電源域設(shè)計(jì)、DVFS 設(shè)計(jì)、時(shí)鐘門控設(shè)計(jì)等低功耗設(shè)計(jì)技術(shù),為如何對開源處理器進(jìn)行低功耗設(shè)計(jì)實(shí)現(xiàn)提供設(shè)計(jì)參考。論文針對 AO486 處理器研究設(shè)計(jì)了一套有效的電源管理方式,將不同的子系統(tǒng)模塊分別劃分成不同的電源域,并且引入 DVFS技術(shù),可以根據(jù)系統(tǒng)實(shí)際的工作負(fù)載情況,調(diào)節(jié)相應(yīng)的工作電壓與工作頻率來提高系統(tǒng)的能效,整個處理器系統(tǒng)的電源狀態(tài)設(shè)計(jì)符合 ACPI 規(guī)范標(biāo)準(zhǔn)。3.2 AO486 處理器系統(tǒng)AO486 是一個 x86 兼容的 Verilog 內(nèi)核,實(shí)現(xiàn)了 486 SX 的所有功能。基于 Bochs軟件實(shí)現(xiàn),核心代碼都經(jīng)過建模和測試驗(yàn)證。
圖 5-2 處理器可視化 power 結(jié)果Fig.5-2 Process DVE power result圖 5-3 電源狀態(tài)仿真波形Fig.5-3 Power state simulation waveform
【學(xué)位授予單位】:上海交通大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2018
【分類號】:TP332
【參考文獻(xiàn)】
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本文編號:2637974
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