容工藝偏差的低偏斜層次化時(shí)鐘網(wǎng)絡(luò)設(shè)計(jì)
[Abstract]:In view of the new characteristics of ultra-deep submicron process, based on the hybrid clock structure of symmetric "H-tree" global clock network and regionalized "Mesh" clock grid, a tree-driven local grid hierarchical clock distribution network is implemented, which is different from the traditional global Mesh structure. The experimental results show that the network has very low deviation and high process deviation tolerance, and its total clock deviation can be controlled within 10 ps. The deviation between the clock deviation and the design value is in the order of 10%, which is very beneficial to the timing design of the processing core of high performance microprocessor.
【作者單位】: 國家高性能集成電路設(shè)計(jì)中心;
【基金】:國家科技重大專項(xiàng)“核高基”(批準(zhǔn)號(hào):2013ZX01028-001-001)資助
【分類號(hào)】:TP332
【參考文獻(xiàn)】
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【共引文獻(xiàn)】
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【相似文獻(xiàn)】
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,本文編號(hào):2527104
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