【摘要】：數(shù)據(jù)加擾有助于避免在高速串行傳輸中出現(xiàn)頻譜雜散,對(duì)JESD204B協(xié)議規(guī)定的加擾電路進(jìn)行了具體設(shè)計(jì)和實(shí)現(xiàn)。首先詳細(xì)描述了協(xié)議要求,以8位并行加擾為例闡述了自同步加擾和解擾的電路原理,最后根據(jù)解擾器輸出狀態(tài)與初始狀態(tài)值有關(guān)這一問(wèn)題提出了改進(jìn)的電路結(jié)構(gòu)以及關(guān)鍵設(shè)計(jì)代碼。仿真結(jié)果表明,該改進(jìn)電路完全滿(mǎn)足協(xié)議要求,可應(yīng)用于JESD204B規(guī)范的高速串行接口電路設(shè)計(jì)。
[Abstract]:Data scrambling is helpful to avoid spectrum spurious in high-speed serial transmission. The scrambling circuit specified by JESD204B protocol is designed and implemented in detail. Firstly, the requirements of the protocol are described in detail, and the circuit principle of self-synchronous scrambling and descrambling is illustrated with 8-bit parallel scrambling as an example. Finally, according to the problem that the output state of the descrambler is related to the initial state value, the improved circuit structure and the key design code are presented. The simulation results show that the improved circuit meets the requirements of the protocol and can be applied to the design of high-speed serial interface circuit of JESD204B specification.
【作者單位】： 中國(guó)地質(zhì)大學(xué)(武漢)機(jī)械與電子信息學(xué)院;
【分類(lèi)號(hào)】：TP334.7

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本文編號(hào)：2434137