【摘要】：為提高多核密碼處理器執(zhí)行ECC算法的速度,在分析ECC算法運(yùn)算特征的基礎(chǔ)上,提出結(jié)合向量、超長(zhǎng)指令字和超標(biāo)量的并行層疊執(zhí)行結(jié)構(gòu),該結(jié)構(gòu)支持ECC算法數(shù)據(jù)級(jí)、線程級(jí)和任務(wù)級(jí)的并行計(jì)算。設(shè)計(jì)ECC單元陣列流水線微結(jié)構(gòu)、中斷控制電路、資源配置表、任務(wù)分配列表以及數(shù)據(jù)輸入輸出管理單元。通過高并行度算法在ECC單元陣列上的映射實(shí)驗(yàn)和性能分析驗(yàn)證了該設(shè)計(jì)對(duì)多核的ECC算法計(jì)算性能提升明顯,適配靈活性更強(qiáng)。
[Abstract]:In order to speed up the execution of ECC algorithm by multi-core cryptographic processor, a parallel cascading execution structure combining vector, super-long instruction word and superscalar is proposed on the basis of analyzing the computing characteristics of ECC algorithm. The structure supports the data level of ECC algorithm. Parallel computing at thread level and task level. The ECC cell array pipeline microstructure, interrupt control circuit, resource configuration table, task allocation list and data input and output management unit are designed. The mapping experiment and performance analysis of high parallelism algorithm on ECC cell array show that the performance of the multi-core ECC algorithm is improved obviously and the adaptability is more flexible.
【作者單位】： 信息工程大學(xué)密碼工程學(xué)院;
【分類號(hào)】：TP332

【參考文獻(xiàn)】

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【二級(jí)參考文獻(xiàn)】

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本文編號(hào)：2358148