【摘要】：在序列密碼算法中,反饋移位寄存器的操作使用頻率高且移位位寬和反饋網(wǎng)絡(luò)靈活多變。針對目前還沒有一個通用可配置且支持不同規(guī)模的移位寄存器實現(xiàn)方法,利用通用可重構(gòu)處理器基本運算單元數(shù)據(jù)流和控制流可配置的特點,充分挖掘移位寄存器中并行流水潛力,在通用可重構(gòu)處理器上,設(shè)計反饋移位寄存器的四種不同實現(xiàn)方案,并對算子在通用處理器以及可重構(gòu)處理器模型上進行性能對比分析。實驗表明,運用可重構(gòu)的方法實現(xiàn)A5密碼算法中的反饋移位寄存器效率較Intel ATOM230處理器提高12.6倍。最后在考慮可重構(gòu)處理器資源制約的條件下,對反饋移位寄存器的實現(xiàn)方法進行優(yōu)化討論。
[Abstract]:In the sequential cipher algorithm, the feedback shift register has high frequency of operation, wide shift bit and flexible feedback network. In view of the fact that there is no universal configurable method to implement shift registers with different sizes, the general reconfigurable processor can be used to configure the data flow of the basic operation unit and the control flow. The potential of parallel pipelining in shift registers is fully exploited. Four different implementation schemes of feedback shift registers are designed on general purpose reconfigurable processors, and the performance of operators on general purpose processors and reconfigurable processor models is compared and analyzed. Experiments show that the efficiency of feedback shift register in A5 cryptosystem is 12.6 times higher than that of Intel ATOM230 processor. Finally, considering the resource constraints of reconfigurable processors, the implementation of feedback shift registers is optimized.
【作者單位】： 解放軍信息工程大學河南省信息安全重點實驗室;
【基金】：國家“863”計劃資助項目(2012AA012704) 國家“973”前期研究項目(2011CB311801)
【分類號】：TP332

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本文編號：2154620