本文選題：Load重用 + 低功耗　； 參考：《微電子學與計算機》2014年06期

【摘要】：針對嵌入式處理器中數(shù)據(jù)Cache功耗顯著的特點,提出了一種基于Load重用的低功耗數(shù)據(jù)Cache設計方法.通過保存Load指令從數(shù)據(jù)Cache中取回的數(shù)據(jù),實現(xiàn)了隨后Load指令對該數(shù)據(jù)的重新使用,從而減少了數(shù)據(jù)Cache的訪問次數(shù),有效降低了數(shù)據(jù)Cache的功耗.在SuperV_EF01DSP上的實驗結果顯示,采用該方法后,在處理器性能沒有損失的情況下,數(shù)據(jù)Cache功耗平均降低29.48%,面積僅增加0.64%.
[Abstract]:Aiming at the significant power consumption of data Cache in embedded processor, a design method of low power data Cache based on Load reuse is proposed. By saving the data retrieved from the data Cache by the Load instruction, the reuse of the data by the subsequent Load instruction is realized, which reduces the number of access to the data Cache and effectively reduces the power consumption of the data Cache. The experimental results on SuperV_EF01DSP show that the data Cache power consumption is reduced by 29.48 and the area is only increased by 0.64 without loss of processor performance.
【作者單位】： 中國科學院大學;中國科學院聲學研究所;
【基金】：國家“九七三”計劃項目(2009CB320202)
【分類號】：TP332

【參考文獻】

相關期刊論文 前2條

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【共引文獻】

相關期刊論文 前6條

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相關博士學位論文 前2條

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【二級參考文獻】

相關期刊論文 前4條

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【相似文獻】

相關期刊論文 前10條

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本文編號：1835000