本文關(guān)鍵詞：108位前導(dǎo)0計數(shù)器的電路設(shè)計與優(yōu)化　出處：《微電子學(xué)與計算機》2015年04期 　論文類型：期刊論文

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【摘要】：采用2位分組進行并行分工計數(shù),使用二叉樹的電路結(jié)構(gòu)進行108位前導(dǎo)0計數(shù)器電路設(shè)計.采用2位分組的108位前導(dǎo)0計數(shù)器電路進行PT分析的時序為0.17,而采用8位分組的RTL級代碼進行DC綜合的時序為0.21,通過比較發(fā)現(xiàn)設(shè)計電路在速度上比RTL級代碼快了19%.
[Abstract]:Two bit groups are used to count the parallel division of labor. The circuit design of 108-bit preamble 0 counter is carried out by using the circuit structure of binary tree, and the timing of PT analysis using 2-bit grouping 108-bit preamble 0 counter circuit is 0.17. The timing of DC synthesis using 8-bit RTL code is 0.21. It is found that the speed of the design circuit is 19 times faster than that of RTL code.
【作者單位】： 國防科學(xué)技術(shù)大學(xué)計算機學(xué)院;
【分類號】：TP332.12
【正文快照】： 1引言在實行浮點運算的減法運算操作中,需要用到一個計數(shù)器對前導(dǎo)0個數(shù)進行統(tǒng)計,獲得的計數(shù)結(jié)果用以指導(dǎo)規(guī)格化移位器進行左移操作[1].傳統(tǒng)前導(dǎo)0計數(shù)器采用逐位計數(shù)方式,從高位往低位依次計算前導(dǎo)0個數(shù).傳統(tǒng)前導(dǎo)0計算速度非常慢,而且所占面積也是非常大,不適合出現(xiàn)在高性能運

【參考文獻】

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【共引文獻】

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