本文關(guān)鍵詞：基于數(shù)據(jù)對象規(guī)模的Rank級內(nèi)存分配方法　出處：《計(jì)算機(jī)研究與發(fā)展》2014年03期 　論文類型：期刊論文

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【摘要】：利用主存的多bank/rank/channel結(jié)構(gòu)挖掘訪存并行性和局部性,是提高系統(tǒng)性能的重要手段.相關(guān)研究工作通過sub-rank技術(shù)增加可并行工作的存儲資源,或在并行程序之間對bank劃分,以隔離訪存沖突.但上述方法沒有考慮在bank/rank資源共存的情況下,單個(gè)程序內(nèi)部數(shù)據(jù)對象間的沖突問題.通過觀察數(shù)據(jù)在主存中的分布,發(fā)現(xiàn)程序的數(shù)據(jù)傾向聚簇于單個(gè)rank中,并提出了一種基于數(shù)據(jù)對象規(guī)模的rank級內(nèi)存分配方法(data object scale aware rank-level memory allocation,DSRA).DSRA將沖突開銷較大的數(shù)據(jù)對象分散到不同的rank,利用增長的bank/rank資源提高訪存性能.DSRA工作在操作系統(tǒng)層,基于編譯器和操作系統(tǒng)提供的信息來分析數(shù)據(jù)對象間的沖突開銷,既不用修改源碼,也不依賴特殊的底層硬件.基于2款真實(shí)處理器對來自NAS Benchmark和SPEC CPU2000中的存儲敏感型基準(zhǔn)測試程序進(jìn)行評測.結(jié)果表明,在不影響cache失效率的情況下,DSRA通過減少主存訪問周期數(shù),可以降低程序的執(zhí)行時(shí)間.與已有的優(yōu)化技術(shù)相比,性能平均提高6.8%,最高性能提升幅度為16%.
[Abstract]:It is an important means to improve the performance of the system by using the multi bank / rank / channel structure of the main memory . The related research work increases the storage resources which can work in parallel or partition the bank between the parallel programs to isolate the memory conflict . However , the method does not consider the problem of conflict between the data objects in the single program under the condition of coexistence of bank / rank resources . DSRA is used to disperse data objects with large collision cost to different rank , and use the raised bank / rank resources to improve the memory performance . The DSRA works on the operating system layer . Based on the information provided by the compiler and the operating system , the conflict cost between the data objects is analyzed . The results show that the DSRA can reduce the execution time of the program without affecting the cache miss efficiency . Compared with the existing optimization technology , the performance of the DSRA can be improved by 6.8 % , and the maximum performance improvement amplitude is 16 % .

【作者單位】： 北京大學(xué)微處理器研究開發(fā)中心;首都師范大學(xué)高可靠嵌入式系統(tǒng)技術(shù)北京市工程技術(shù)研究中心;
【基金】：“核高基”國家科技重大專項(xiàng)基金項(xiàng)目(2009ZX01029-001-002)
【分類號】：TP333.1
【正文快照】： 處理器和主存之間存在較大的性能差距.cache利用局部性減少處理器訪問主存的次數(shù),但片上集成cache的容量有限,并且單一的替換策略也難以滿足程序訪存行為的多樣性[1].對于存儲敏感型應(yīng)用,處理器會耗費(fèi)大量時(shí)間用于訪問主存,因此需要主存更加快速響應(yīng)處理器的訪存請求.當(dāng)前主存

【共引文獻(xiàn)】

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