發(fā)布時(shí)間：2017-11-19 11:10

  本文關(guān)鍵詞：基于FPGA的浮點(diǎn)除法器的研究與實(shí)現(xiàn)

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【摘要】：文章針對現(xiàn)場可編程門陣列(FPGA)器件的某些芯片不支持浮點(diǎn)除法運(yùn)算的情況,設(shè)計(jì)出一種輸出為32位的單精度浮點(diǎn)數(shù)的除法器。文章利用已有的整數(shù)除法器的IP核(IP Core)進(jìn)行改進(jìn),大大的降低了程序設(shè)計(jì)的復(fù)雜性,并且保證了可靠性。通過Model Sim仿真軟件,證明我們設(shè)計(jì)的算法結(jié)果正確,完全滿足要求。
【作者單位】： 煙臺大學(xué);
【基金】：煙臺大學(xué)研究生科技創(chuàng)新基金(基金編號:YDYB1615)
【分類號】：TP332.22
【正文快照】： 1引言隨著數(shù)字信號處理技術(shù)的不斷發(fā)展,人們對數(shù)據(jù)的精確性和處理的實(shí)時(shí)性的要求日益提高,浮點(diǎn)數(shù)逐漸取代定點(diǎn)數(shù)成為應(yīng)用最廣的數(shù)據(jù)格式[1-2]。在數(shù)字信號處理中,浮點(diǎn)數(shù)經(jīng)常用IEEE754標(biāo)準(zhǔn)來表示,這是一種通用的標(biāo)準(zhǔn),有了這種標(biāo)準(zhǔn),不同器件之間的數(shù)據(jù)就可以方便的流動。在FPGA

【參考文獻(xiàn)】

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【相似文獻(xiàn)】

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本文編號：1203337