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矩陣變換器自抗擾控制的優(yōu)化研究

發(fā)布時間:2021-01-27 23:10
  針對矩陣變換器的輸出側(cè)性能易受各種不確定性和擾動影響的問題,在此提出一種優(yōu)化的矩陣變換器自抗擾控制(ADRC)方法。該方法是在傳統(tǒng)自抗擾控制器的基礎(chǔ)上,通過采用降階的廣義比例積分觀測器(GPIO)代替自抗擾控制器中的擴張狀態(tài)觀測器來對其進行優(yōu)化。降階GPIO具有同時估計狀態(tài)以及時變的不確定性與擾動信號的特性,即使在存在擾動和不確定性的情況下,也能使控制系統(tǒng)具有更快的響應(yīng)速度和更合適的平滑輸出。最后通過仿真與實驗結(jié)果表明,采用優(yōu)化的ADRC不僅使矩陣變換器系統(tǒng)具有良好的輸出性能,而且對各種擾動和不確定性也有很強的魯棒性能。 

【文章來源】:電力電子技術(shù). 2020,54(09)北大核心

【文章頁數(shù)】:5 頁

【部分圖文】:

矩陣變換器自抗擾控制的優(yōu)化研究


圖3虛擬逆變側(cè)等效電路結(jié)構(gòu)圖??Fig.?3?Equivalent?circuit?structure?of?virtual?inverter??其狀態(tài)方程為:??

矩陣變換器,輸入電壓


GPIO估計擾動的導(dǎo)數(shù)可以提高控制??方法的控制精度,進而使控制系統(tǒng)更加快速和準(zhǔn)??確。優(yōu)化ADRC結(jié)構(gòu)如圖4所示。??TD??NLSEF??-[£3/6.??降階??GPIO??優(yōu)化的ADRC結(jié)構(gòu)??of?the?optimized?ADRC??4??矩陣變換器的自抗擾控制??在此對矩陣變換器的開關(guān)算法采用間接空間??矢纛調(diào)制法,并由式(5)可知,對矩陣變換器的虛??擬逆變側(cè)采用4個一階優(yōu)化的ADRC用于其系統(tǒng)??的控制。采用優(yōu)化后ADRC的矩陣變換器系統(tǒng)框??圖如圖5所示。??的輸入和輸出信號進行觀測來實時估計系統(tǒng)的狀??態(tài)和擾動,并且不依賴于產(chǎn)生擾動的具體數(shù)學(xué)模??型。NLSEF主要是補償系統(tǒng)的參數(shù)與擾動,同時抑??制外部擾動以及根據(jù)TD與ES0兩者輸出之間的??誤差來形成對象所需的控制量。自抗擾控制器的??各重要組成模塊的表達形式如下17|:??(1)TD:??^1=^2,??(2)ES0:??ii2=-/?sa/|i,|-v0+^-|i;2?|?,5。??(7)??(8)??(9)??sai(x?,5)?=??/a/(e,a,5):??(l〇)??(ID??Ie=z\-y,?2|^z2〇(e?,ck,,5i〉??z^j-P^faKe?,a2,S2)+bu,?,a3,53)??(3)NLSEF:??ie,=V|-z,,?C2=r2-z2??lu〇=Ki/a/(e|?,a4,S4)+^j/a/(e2,a5,S5),?u^Uo-z^/b??式中:叫為輸入給定值為《。的跟蹤值;《為可調(diào)參數(shù);??y為系統(tǒng)的撤測輸出;&分別為的估計值;2,為總??擾動的估計值;取,/82,負(fù)為可調(diào)參

質(zhì)量圖,仿真波形,正弦,電壓波形


輸送給開??關(guān)換流控制器實現(xiàn)對矩陣變換器的控制。??4.1?電壓環(huán)的ADRC??由上述可知,電壓環(huán)采用2個一階優(yōu)化的??ADRC。其各個組成部分表達形式如下:??(1)TD:??v?l=-Rsat(vi-ux'?,8)?(15)??(2)降階?GPIO:??)81=10?000,)82=90?000;〇:1=〇(2=0.2,5|=52=0.01,其他??參數(shù)同優(yōu)化的ADRC。為更好地驗證優(yōu)化后ADRC??的控制性能,選擇在三相輸入電壓不平衡的條件??下進行仿真。仿真波形如圖6所示。??(b)采用傳統(tǒng)ADRC的三相輸出電壓(C成用優(yōu)化ADRC的三相輸出電壓??圖6仿真波形??Fig.?6?Simulation?waveforms??對比圖6b,c可見,采用優(yōu)化的ADRC的輸出??電壓波形比傳統(tǒng)ADRC的輸出電壓波形質(zhì)量高、??正弦度好。用Matlab對輸出電壓的數(shù)據(jù)進行計算??處理可得,采用傳統(tǒng)ADRC輸出電壓77/Z)=4.06%?,??而優(yōu)化的ADRC輸出電壓的77/0=2.89%,說明優(yōu)??化的ADRC具有更好的控制性能。??5.2?實驗??利用基于DSP+FPGA為主控制器的樣機實驗??設(shè)備來對所提優(yōu)化ADRC方法的有效性進行驗??證。為進行對比分析,在相同實驗參數(shù)條件下,分??別對傳統(tǒng)ADRC方法與此處介紹的ADRC方法進??行了實驗研宄。實驗參數(shù)與仿真參數(shù)相同。實驗同??樣是在三相輸入電壓不平衡的條件下進行,實驗??波形如圖7所示。??第54卷第9期??2020年9月??電力電子技術(shù)??Power?Electronics??Vol.54,?No.9??September?202

【參考文獻】:
期刊論文
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本文編號:3003894

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