工程地震儀中數據集中器的研究與實現
【學位單位】:重慶大學
【學位級別】:碩士
【學位年份】:2016
【中圖分類】:P631.43
【部分圖文】:
重慶大學碩士學位論文電路設計路設計據需求分析可以看出,在設定采樣頻率為數據量已經達到 56.25Mbit,所以必須采數據存儲量、數據吞吐率、系統(tǒng)最高時存選用 Hynix公司生產的 HY57V56820 12 根地址線,行地址線(A0—A12)和 4 個 bank,所以單片 SDRAM 存儲提供了參考時鐘的上升沿完全同步操作沿同步。其數據路徑內部流水線達到非VTTL 兼容[20]。該系列芯片工作頻率可足數據存儲要求。
M_CLK O 時鐘M_CKE O 時鐘使能信號M_CS_N O 片選信號_DQ[7:0] I/O 數據M_WE_N O 命令M_DQM O 數據掩碼電路設計中的數據傳輸至數據集中器,需要制定相應的成熟的數據傳輸有 RS232 以及 RS485 兩種。最大為 15 m,最高速率為 20 KB/s,且僅支平衡發(fā)送和差分接收,最大通信距離約為 1本文采用 RS485 來實現數據傳輸,設定波特器部分的 RS485 電路原理圖。
重慶大學碩士學位論文邏輯電路設計字檢波器的核心邏輯器件采用 Altera 公司的 EP3C10E144C8。FPGA 是整體系統(tǒng)的主控單元,它管理著整個系統(tǒng)的運行。ADS1271 芯片模數率、SDRAM芯片HY57V56820的讀寫操作以及串口通信的執(zhí)行,均由F控制。GA 作為主控單元,需要與多個模塊進行通信。依據 EP3C10E144C8 技課題硬件需求,設計了如圖 3.5 所示的 FPGA 電路原理圖,實現對 A、RS485/上位機通信等模塊的集中控制。
【參考文獻】
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本文編號:2821088
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