基于LT碼的無碼率極化碼的設(shè)計(jì)與實(shí)現(xiàn)
【學(xué)位授予單位】:華中科技大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2019
【分類號(hào)】:TN911.22
【圖文】:
圖 3.5 異或計(jì)算單元功能仿真時(shí)序圖3.2.3 存儲(chǔ)單元LT 碼譯碼單元的儲(chǔ)存單元由度存儲(chǔ) RAM、輸入數(shù)據(jù)存儲(chǔ) RAM、相關(guān)信息存儲(chǔ)RAM 以及解碼輸出數(shù)據(jù) RAM 組成。輸入數(shù)據(jù)存儲(chǔ) RAM 用于緩存輸入的編碼分組,度存儲(chǔ) RAM 用于儲(chǔ)存對(duì)應(yīng)編碼分組的度值。輸入數(shù)據(jù)存儲(chǔ) RAM 和度存儲(chǔ) RAM 的大小為 LT 碼譯碼設(shè)定的最大編碼分組數(shù)目。在 AXI4-Stream 接口輸入有效時(shí),對(duì)這兩個(gè) RAM 進(jìn)行寫入操作,這兩個(gè) RAM 的尋址規(guī)律為順序?qū)ぶ,每次地址?1。在度為 1 讀取狀態(tài)和異或計(jì)算過程數(shù)據(jù)讀取狀態(tài)下,對(duì)這兩個(gè) RAM 進(jìn)行讀取操作,在度為 1 讀取狀態(tài),地址順序?qū)ぶ,每次地址?1,在異或計(jì)算過程數(shù)據(jù)讀取狀態(tài)下,讀取地址需要根據(jù)控制邏輯產(chǎn)生。除此之外在度為 1 數(shù)據(jù)計(jì)算和存儲(chǔ)狀態(tài)和異或計(jì)算過程數(shù)據(jù)計(jì)算和存儲(chǔ)狀態(tài)下也需要對(duì)這兩個(gè) RAM 進(jìn)行寫入操作,寫入操作的地址和上一狀態(tài)讀取的地址相同。由于
圖 3.10 輸入控制單元功能仿真時(shí)序圖3.3.3 比特狀態(tài)計(jì)數(shù)器比特狀態(tài)計(jì)數(shù)器用于指示當(dāng)前譯碼比特的序號(hào),每當(dāng)完成一個(gè)比特的對(duì)數(shù)似然比和部分和計(jì)算后,比特狀態(tài)計(jì)數(shù)器的值就會(huì)加 1,極化碼譯碼單元的其他單元均根據(jù)當(dāng)前比特的指示進(jìn)行工作。1b10bLoadCounter Value10bResetLoad ValueCNTREGLOADVALUEREGMUX1b
圖 3.13 對(duì)數(shù)似然比功能仿真時(shí)序圖1.當(dāng)前層計(jì)算單元對(duì)于單個(gè)比特,SC 譯碼算法可視為如圖 3.14 所示的一顆計(jì)算樹[39,40],對(duì)于單個(gè)對(duì)數(shù)似然比計(jì)算核心的譯碼單元設(shè)計(jì)需要根據(jù)內(nèi)部計(jì)數(shù)器的計(jì)數(shù)器值確定當(dāng)前計(jì)算的對(duì)數(shù)似然比在樹中的層序號(hào),定義頂層序號(hào)為第 0 層。當(dāng)前層的計(jì)算輸入為內(nèi)部計(jì)數(shù)器的計(jì)數(shù)器值。
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