本文選題：JESDB實(shí)現(xiàn)　切入點(diǎn)：高速串行傳輸　出處：《西安電子科技大學(xué)學(xué)報(bào)》2017年04期 　論文類型：期刊論文

【摘要】：為減少引腳數(shù),降低封裝成本和尺寸,簡化系統(tǒng)設(shè)計(jì),電子器件工程聯(lián)合委員會(huì)提出了一種高速串行接口協(xié)議JESD204B.文中呈現(xiàn)了該接口收發(fā)機(jī)控制器的具體實(shí)現(xiàn)方案,并且基于Xilinx的現(xiàn)場可編程門陣列中的高速串行收發(fā)器GTH,在6.25Gbit/s的數(shù)據(jù)速率下完成了4個(gè)通道的JESD204B接口收發(fā)機(jī)控制器的驗(yàn)證.
[Abstract]:In order to reduce the number of pins, reduce the cost and size of packaging and simplify the design of the system, JESD204B. a high speed serial interface protocol is proposed by the Electronic device Engineering Joint Committee. In this paper, the implementation of the controller for the interface transceiver is presented. And the high-speed serial transceiver in the field programmable gate array based on Xilinx is verified at the data rate of 6.25Gbit / s. The JESD204B interface transceiver controller with four channels is verified.
【作者單位】： 西安電子科技大學(xué)微電子學(xué)院;
【基金】：國家自然科學(xué)基金資助項(xiàng)目(61504103,61574103,61574105)
【分類號(hào)】：TN915.04

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本文編號(hào)：1620316