本文關(guān)鍵詞：Burg頻譜估計(jì)算法的硬件加速方法研究

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【摘要】：基于Burg算法的現(xiàn)代譜估計(jì)相對(duì)于基于FFT算法的經(jīng)典譜估計(jì),具有更好的實(shí)時(shí)性和頻率分辨率。然而Burg算法中需要的大量迭代運(yùn)算,降低了實(shí)時(shí)系統(tǒng)的性能。為進(jìn)一步提高頻譜估計(jì)的速度,提出一種Burg算法的硬件加速方法。該方法以高性能FPGA為平臺(tái),遵循并行計(jì)算的思想,根據(jù)Burg算法的特點(diǎn),巧妙的利用FPGA內(nèi)部的DSP資源和RAM處理數(shù)學(xué)運(yùn)算與存儲(chǔ)器管理兩大核心問題。通過在速度和面積上的折中優(yōu)化系統(tǒng)性能。實(shí)驗(yàn)結(jié)果表明,該加速方法能較為準(zhǔn)確的估計(jì)出脈沖編碼雷達(dá)中目標(biāo)物體的多普勒頻偏。通過進(jìn)行比較發(fā)現(xiàn),該方法提高了系統(tǒng)的運(yùn)算速度和性能。
【作者單位】： 懷化學(xué)院物理與信息工程系;懷化學(xué)院武陵山片區(qū)生態(tài)農(nóng)業(yè)智能控制技術(shù)湖南省重點(diǎn)實(shí)驗(yàn)室;
【關(guān)鍵詞】： 功率譜估計(jì) Burg算法 FPGA
【基金】：湖南省科技計(jì)劃(2013GK3145) 湖南省教育廳科學(xué)技術(shù)研究(10C1057)項(xiàng)目
【分類號(hào)】：TN911.7
【正文快照】： 1引言頻譜分析與估計(jì)是一個(gè)基本問題,廣泛存在于儀器儀表[1]、通信信號(hào)處理[2]、電力諧波分析[3-4]、機(jī)械故障診斷及生物醫(yī)學(xué)工程等領(lǐng)域中[5-6]。如何快速進(jìn)行頻譜分析既是一個(gè)科學(xué)課題,也是一個(gè)工程問題。功率譜估計(jì)方法總體上說,可分為經(jīng)典功率譜估計(jì)(非參數(shù)化方法)和現(xiàn)代功

【參考文獻(xiàn)】

中國(guó)期刊全文數(shù)據(jù)庫 前10條

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本文編號(hào)：548573