本文關(guān)鍵詞：基于FPGA的串并集合排序在雷達(dá)系統(tǒng)中的應(yīng)用，由筆耕文化傳播整理發(fā)布。

【摘要】：基于FPGA硬件技術(shù),以資源和時間相結(jié)合的思路,提出了一種串并結(jié)合的比較排序算法。該算法通過對數(shù)據(jù)的分時并行比較,計算出每個數(shù)據(jù)在排序中的位置實(shí)現(xiàn)數(shù)據(jù)排序。該算法可在較短的時間內(nèi)實(shí)現(xiàn)數(shù)字序列的排序,通過實(shí)驗(yàn)證明,資源消耗少,實(shí)時性號,通用性強(qiáng)。
【作者單位】： 南京電子技術(shù)研究所;
【關(guān)鍵詞】： 排序 FPGA 并行 串行
【分類號】：TN974
【正文快照】： 在雷達(dá)抗干擾處理以及空時二維處理過程中數(shù)據(jù)排序?qū)⒈夭豢擅鈁1],在傳統(tǒng)的DSP、CPU等常規(guī)軟件排序已經(jīng)不能夠滿足雷達(dá)系統(tǒng)實(shí)時性要求,使用FPGA排序的趨勢將勢不可當(dāng)。FPGA由于具有較高的并行處理能力,目前已成為雷達(dá)陣列信號處理中的主流處理器件。計算耗費(fèi)的時間和消耗的硬件

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