【摘要】：針對(duì)高級(jí)加密標(biāo)準(zhǔn)(AES)S-盒優(yōu)化,提出了一種新的多因子公共項(xiàng)消除(CSE)優(yōu)化算法.多因子CSE算法通過(guò)對(duì)組合邏輯表達(dá)式中所含因子最多的公共項(xiàng)優(yōu)先消除,以簡(jiǎn)化邏輯表達(dá)式,從而有效地減少S-盒電路結(jié)構(gòu)中的GF(2^4)域乘法逆電路和映射矩陣電路的面積和時(shí)延.結(jié)果表明,多因子CSE算法具有計(jì)算速度快,優(yōu)化效率高的特點(diǎn).優(yōu)化后的S-盒組合邏輯電路采用0.18μm CMOS工藝,設(shè)計(jì)出的S-盒面積-延時(shí)積比目前最小面積和最短延時(shí)的S-盒組合邏輯電路分別減少了10.32%和19.64%.
[Abstract]:A new multi-factor common item cancellation (CSE) optimization algorithm is proposed for the advanced encryption standard (AES) S- box optimization. The multifactor CSE algorithm simplifies the logical expression by eliminating the common item with the most factors in the combinational logic expression. Therefore, the area and delay of the GF (2 ^ 4) domain multiplication inverse circuit and the mapping matrix circuit in the S- box circuit structure are effectively reduced. The results show that the multi-factor CSE algorithm has the advantages of fast computing speed and high optimization efficiency. The optimized S- box combinational logic circuit adopts 0.18 渭 m CMOS technology. The designed S- box area-delay product is 10.32% and 19.64% less than that of the current S- box combinational logic circuit with minimum area and shortest delay, respectively.
【作者單位】： 南京航空航天大學(xué)電子信息工程學(xué)院;
【基金】：國(guó)家自然科學(xué)基金資助項(xiàng)目(No.61376025,No.61106018) 江蘇省產(chǎn)學(xué)研前瞻性聯(lián)合研究項(xiàng)目(No.BY2013003-11)
【分類(lèi)號(hào)】：TN918.4

【參考文獻(xiàn)】

相關(guān)期刊論文 前2條

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【共引文獻(xiàn)】

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【二級(jí)參考文獻(xiàn)】

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【相似文獻(xiàn)】

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本文編號(hào)：2296699