【摘要】：適用于三頻段信號的中頻接收機(jī)硬件設(shè)計管腳多,時序復(fù)雜,設(shè)計周期長,需要注意的細(xì)節(jié)問題太多,一個電路設(shè)計的小問題都有可能使整個板子返工,費(fèi)事費(fèi)力,針對此問題,設(shè)計三頻段信號的模擬收發(fā)系統(tǒng),系統(tǒng)由LabVIEW平臺的FPGA程序和主控計算機(jī)程序組成,在主控計算機(jī)內(nèi),生成三頻段信號后,經(jīng)DMA FIFO傳輸至PXIe-5641R板卡,然后送至上變頻器,輸出中頻信號;信號接收時,首先經(jīng)AD6654進(jìn)行下變頻后,經(jīng)過FPGA的數(shù)據(jù)調(diào)理過程送至主控計算機(jī)進(jìn)行顯示;最后測量了信號波形,驗證了收發(fā)系統(tǒng)的有效性。
[Abstract]:The hardware design of intermediate frequency receiver suitable for three frequency band signal has many pins, complex timing, long design period, too many detail problems that need to be paid attention to. A small problem in the circuit design can make the whole board rework and take trouble and effort. To solve this problem, a three-band analog transceiver system is designed. The system is composed of the FPGA program of the LabVIEW platform and the master computer program. In the main control computer, the three-band signal is generated and transmitted to the PXIe-5641R card through DMA FIFO. Then the first frequency converter is sent to output the intermediate frequency signal. When the signal is received, the data conditioning process of FPGA is sent to the main control computer for display after the down conversion by AD6654. Finally, the signal waveform is measured, and the validity of the transceiver system is verified.
【作者單位】： 軍械工程學(xué)院電子與光學(xué)工程系;63961部隊;
【基金】：國家自然科學(xué)基金青年基金(51107147)
【分類號】：TN957.5

【參考文獻(xiàn)】

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本文編號：2180518