本文選題：短猝發(fā) + 擴頻��； 參考：《西安電子科技大學》2015年碩士論文

【摘要】：隨著現(xiàn)代通信技術的快速發(fā)展,人們對通信系統(tǒng)的抗干擾和抗截獲能力要求越來越高,尤其在軍事通信中這種需求更為迫切。本文對抗干擾和抗截獲相關理論進行了探討,設計出了一種基于短猝發(fā)、擴頻技術與LDPC碼的通信方案,實現(xiàn)了一種抗干擾和抗截獲性能較好的通信系統(tǒng)。為了使本系統(tǒng)抗截獲性能得到進一步提升,還與合作單位的子帶分割、子帶合并模塊進行了聯(lián)試。信號頻譜按照既定規(guī)則被分割成多個子帶后,即使敵方截獲信號后也很難恢復出原信號。本文的主要內容及工作如下:1.對系統(tǒng)關鍵技術進行了深入的研究,包括匹配濾波、同步捕獲、擴頻解擴技術、LDPC碼編譯碼理論。此外,本文還對設計中使用的PMF-FFT方法做了詳細的推導。2.對系統(tǒng)中關鍵模塊進行了Matlab仿真分析,給出了該系統(tǒng)的性能仿真結果,滿足設計要求。本文在討論同步捕獲模塊時,提出了一種改進的同步捕獲方案,并對改進方案性能做了仿真分析。3.在FPGA實現(xiàn)時,提出了一種可以實現(xiàn)實時同步捕獲的設計方案,該方案可以將同步捕獲模塊進行時分復用,節(jié)省了大量的FPGA資源。4.基于Matlab定點程序對系統(tǒng)各模塊進行FPGA設計,詳細闡述了各模塊的設計思想及實現(xiàn)過程,并進行功能仿真。然后,利用SignalTap II對系統(tǒng)進行了板級調試。5.對聯(lián)試方案進行了分析,給出了聯(lián)試后的系統(tǒng)結構框圖。最后,利用SignalTapII對聯(lián)試后程序進行了板級調試。
[Abstract]:With the rapid development of modern communication technology, people demand more and more anti-jamming and anti-interception ability of communication system, especially in military communication. This paper discusses the theory of anti-jamming and anti-interception, designs a communication scheme based on short burst, spread spectrum technology and LDPC code, and realizes a communication system with good performance of anti-jamming and anti-interception. In order to further improve the anti-interception performance of the system, the sub-band merging module is combined with the sub-band of the cooperative unit. After the signal spectrum is divided into several sub-bands according to the established rules, it is difficult to recover the original signal even after the enemy intercepts the signal. The main contents and work of this paper are as follows: 1. The key technologies of the system are studied, including matched filtering, synchronization acquisition, spread spectrum despreading technology and LDPC coding and decoding theory. In addition, this paper also makes a detailed derivation of the PMF-FFT method used in the design. The key modules of the system are simulated by Matlab, and the simulation results of the system performance are given to meet the design requirements. In this paper, an improved synchronization capture scheme is proposed, and the performance of the improved scheme is simulated and analyzed. In the implementation of FPGA, a design scheme that can realize real-time synchronous capture is proposed. This scheme can realize time division multiplexing of synchronization capture module and save a lot of FPGA resources. 4. Based on the fixed point program of Matlab, the FPGA design of each module of the system is carried out. The design idea and realization process of each module are described in detail, and the function simulation is carried out. Then, the system is debugged at board level by using SignalTap II. The test scheme is analyzed, and the system structure block diagram after the joint test is given. Finally, the board level debugging is carried out by using SignalTapII to test the program.
【學位授予單位】：西安電子科技大學
【學位級別】：碩士
【學位授予年份】：2015
【分類號】：E96;TN973.3

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本文編號：1905214