本文選題：射頻拉遠(yuǎn) + 時(shí)鐘漂移　； 參考：《南開大學(xué)》2014年博士論文

【摘要】：本文針對(duì)TD-LTE射頻拉遠(yuǎn)系統(tǒng)中時(shí)鐘漂移問題和下行鏈路基帶信號(hào)峰均功率比過高的問題,研究適用于該系統(tǒng)的時(shí)間同步技術(shù)和峰均比抑制技術(shù),以提高系統(tǒng)誤碼性能。通過對(duì)時(shí)間同步方案進(jìn)行硬件實(shí)現(xiàn)和對(duì)峰均比抑制算法進(jìn)行性能仿真,分別實(shí)現(xiàn)了系統(tǒng)高精度和高性能的設(shè)計(jì)要求。 TD-LTE射頻拉遠(yuǎn)系統(tǒng)中,基帶控制部分和射頻拉遠(yuǎn)單元之間的時(shí)鐘漂移問題導(dǎo)致時(shí)鐘頻率穩(wěn)定度降低,從而影響系統(tǒng)誤碼性能。針對(duì)該問題,本文提出了一種利用鎖相環(huán)進(jìn)行時(shí)鐘同步的技術(shù)。該技術(shù)利用鎖相環(huán)的特點(diǎn),通過跟蹤時(shí)鐘漂移并對(duì)時(shí)鐘信號(hào)進(jìn)行預(yù)補(bǔ)償來(lái)達(dá)到抵消時(shí)鐘漂移的目的。本文首先從鎖相環(huán)基本原理的研究著手,通過分析傳統(tǒng)鎖模激光器穩(wěn)頻方法的優(yōu)缺點(diǎn),提出了利用鎖相環(huán)芯片的激光穩(wěn)頻方案,保證本地時(shí)鐘具有較高的頻率穩(wěn)定度。在分析了時(shí)鐘漂移的產(chǎn)生和影響以及傳統(tǒng)時(shí)鐘同步方法的優(yōu)缺點(diǎn)的基礎(chǔ)上,本文提出了基于鎖相環(huán)的時(shí)鐘漂移補(bǔ)償方案。對(duì)該方案的可行性進(jìn)行理論分析的同時(shí),本文設(shè)計(jì)并制作了集成在一塊4層印刷電路板中的時(shí)鐘同步模塊,包括本地激光穩(wěn)頻模塊、時(shí)鐘漂移測(cè)量和補(bǔ)償模塊、評(píng)估模塊以及控制電路模塊。對(duì)時(shí)鐘同步模塊的測(cè)試表明：加入時(shí)鐘同步模塊的時(shí)鐘信號(hào)頻率穩(wěn)定度可達(dá)到10m,較之無(wú)同步模塊,提高了4個(gè)數(shù)量級(jí)；分別對(duì)實(shí)驗(yàn)室環(huán)境下10Km和100Km單程光纖鏈路的測(cè)試表明,該方案能達(dá)到同樣的效果。因此,該技術(shù)可以在較大的動(dòng)態(tài)范圍內(nèi)補(bǔ)償時(shí)鐘漂移,提高時(shí)鐘信號(hào)的頻率穩(wěn)定度,從而提高系統(tǒng)誤碼性能。 本文從OFDM基帶信號(hào)高峰均功率比的特點(diǎn)出發(fā),研究了下行鏈路基帶信號(hào)的高峰均比問題對(duì)功率放大器的影響。該問題將導(dǎo)致射頻拉遠(yuǎn)單元功率放大器的效率降低,并引起系統(tǒng)誤碼性能惡化。為了抑制較高的峰均比,減小功率放大器的非線性對(duì)系統(tǒng)誤碼性能的影響,本文提出了改進(jìn)的預(yù)留載波法以及該方法和改進(jìn)的交織分割部分傳輸序列(IP-PTS)方法的聯(lián)合算法。改進(jìn)的預(yù)留載波法利用基帶信號(hào)具有較多空子載波的特點(diǎn),結(jié)合預(yù)留載波法無(wú)需傳遞邊帶信息的優(yōu)點(diǎn),將部分空子載波作為預(yù)留載波,通過疊加的方式對(duì)原始基帶信號(hào)的高峰值進(jìn)行抑制。該方法僅需利用少量空子載波即可得到較好的峰均比抑制性能。聯(lián)合算法對(duì)傳統(tǒng)IP-PTS進(jìn)行了改進(jìn),在不影響算法性能的基礎(chǔ)上降低了運(yùn)算復(fù)雜度,同時(shí)結(jié)合改進(jìn)的預(yù)留載波法,進(jìn)一步改善了峰均比抑制性能。仿真結(jié)果驗(yàn)證了兩種算法的有效性。與傳統(tǒng)IP-PTS算法相比,改進(jìn)的預(yù)留載波法和聯(lián)合算法分別實(shí)現(xiàn)了1.8dB和2.9dB的性能提升。
[Abstract]:In this paper , the time synchronization technique and peak - to - average ratio suppression technique for the TD - LTE radio - frequency pull - off system are studied to improve the system error - code performance . The hardware implementation and the peak - to - average - ratio - suppression algorithm for the time synchronization scheme are simulated to realize the high - precision and high - performance design requirements of the system respectively .

In this paper , a clock drift compensation scheme based on phase locked loop is proposed in this paper , which is based on the basic principle of phase locked loop .
Therefore , the technique can compensate the clock drift in a large dynamic range , improve the frequency stability of the clock signal , and improve the error performance of the system .

In this paper , the influence of peak - to - average ratio of downlink baseband signal on power amplifier is studied from the characteristics of peak - to - average power ratio of OFDM baseband signal . The problem will reduce the efficiency of RF pull - off unit power amplifier and decrease the performance of system error code . In order to suppress higher peak - to - average ratio and reduce the nonlinear system error performance of power amplifier , this paper proposes an improved reserved carrier method .

【學(xué)位授予單位】：南開大學(xué)
【學(xué)位級(jí)別】：博士
【學(xué)位授予年份】：2014
【分類號(hào)】：TN929.5

【參考文獻(xiàn)】

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本文編號(hào)：1802054