作為任務(wù)規(guī)劃系統(tǒng)核心功能,航跡規(guī)劃對提高精確制導(dǎo)武器的突防能力,實(shí)現(xiàn)對目標(biāo)的精確打擊起著重要作用。如何提高航跡規(guī)劃的速度是當(dāng)前航跡規(guī)劃研究的重要課題之一。為提高航跡規(guī)劃的速度,可以從兩方面著手,一方面是從航跡規(guī)劃算法入手,通過對航跡快速算法的研究提高航跡規(guī)劃算法的效率;另一方面是提高航跡規(guī)劃系統(tǒng)硬件平臺(tái)的性能。本文主要對航跡規(guī)劃系統(tǒng)硬件平臺(tái)進(jìn)行討論,設(shè)計(jì)了基于三片DSP（TMS320C6455）的航跡規(guī)劃系統(tǒng)硬件平臺(tái),主要包括以下幾部分內(nèi)容:根據(jù)航跡規(guī)劃系統(tǒng)數(shù)據(jù)密集型特點(diǎn)對主要芯片進(jìn)行了選型,在選定芯片型號(hào)基礎(chǔ)上,討論了多DSP互連方案,最終確定了硬件平臺(tái)的具體系統(tǒng)方案。完成了硬件平臺(tái)各個(gè)模塊的設(shè)計(jì),包括PCI總線和千兆網(wǎng)對外接口的設(shè)計(jì),DDR2 SDRAM,Flash和I2C EEPROM存儲(chǔ)擴(kuò)展設(shè)計(jì),EMIF和McBSP互連設(shè)計(jì)以及FPGA核心電路、電源、時(shí)鐘、監(jiān)控和復(fù)位電路、JTAG接口設(shè)計(jì)等。并在高速電路設(shè)計(jì)理論指導(dǎo)下完成了系統(tǒng)硬件平臺(tái)PCB設(shè)計(jì)。提出了基于總線仲裁的新型多DSP對等全互連結(jié)構(gòu),該方法結(jié)構(gòu)簡單,數(shù)據(jù)傳輸靈活,多個(gè)DSP地位平等,不分主從�？偩�仲裁及通信協(xié)議由FP... 

【文章來源】：華中科技大學(xué)湖北省 211工程院校 985工程院校 教育部直屬院校

【文章頁數(shù)】：74 頁

【學(xué)位級(jí)別】：碩士

【部分圖文】：

TMS320C6455的整體結(jié)構(gòu)框圖

9圖 2.2 C64x+內(nèi)核模塊框圖C64x+ 的 兩 個(gè) 數(shù) 據(jù) 通 路 是 一 個(gè) 完 全 對 稱 的 結(jié) 構(gòu) ， 每 個(gè) 數(shù) 據(jù) 通 道.S、.M、.D 四個(gè)功能單元和一個(gè)包括 32 個(gè) 32 位寄存器的寄存器組。.M門的乘法運(yùn)算單元。.S 和.L 單元執(zhí)行運(yùn)算、邏輯和分支等功能。.D 單元據(jù)的存取操作。這八個(gè)功能單元都能夠在單時(shí)鐘周期完成一條指令。A 和用寄存器組分別包含 32 個(gè) 32 位的寄存器。這些寄存器可用于存儲(chǔ) 8 位、、40 位和 64 位數(shù)據(jù)格式的數(shù)據(jù)。對于大于 32 位的數(shù)據(jù)用寄存器組的方兩個(gè)數(shù)據(jù)通道的 4 個(gè)功能單元的操作數(shù)之一都可來自另一側(cè)的寄存器組數(shù)據(jù)通路的交互。C64x+數(shù)據(jù)通路結(jié)構(gòu)如圖 2.3 所示。

10圖 2.3 C64x+內(nèi)核數(shù)據(jù)通路C64x+內(nèi)核對 C64x 內(nèi)核的功能單元進(jìn)行了擴(kuò)展，同時(shí)還增加了一些新的處理能力大大提高。C64x+對.M、.L、.S 功能單元都進(jìn)行了功能擴(kuò)展。對單元，除了能完成 C64x .M 功能單元能完成的工作外，它還能在單時(shí)鐘周

【參考文獻(xiàn)】：
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博士論文
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本文編號(hào)：3495827