本文關鍵詞：一種分布式FPGA協(xié)處理器平臺的研究與設計，，由筆耕文化傳播整理發(fā)布。

【摘要】：隨著互聯(lián)網(wǎng)和計算機技術的發(fā)展,無論是科研任務還是人民大眾的日常生活需求對計算處理任務的要求不斷提升,計算機應用軟件的處理壓力越來越重,同時對計算機自身的處理能力也給出了更高的要求,硬件協(xié)處理器的加入成為時代發(fā)展的趨勢和社會發(fā)展的需求。 由于分布式技術是可以把大的計算任務拆解成多個小任務,并且能夠將這些小任務分配到多個處理器上進行處理,從而使得任務能夠得到并行處理,大大地提高處理效率。由于FPGA具有高速度、低功耗、可重構、并行資源豐富等特征,通過硬件設計專用的FPGA協(xié)處理器,能夠充分利用FPGA的資源,發(fā)揮其硬件加速的優(yōu)勢,能夠提高整個系統(tǒng)的處理效率和響應速度。同時,把這種分布式理念運用到FPGA的研究中,可以充分利用并發(fā)揮FPGA的硬件優(yōu)勢,以期發(fā)揮FPGA協(xié)處理器平臺的最大處理能力。 本論文中的FPGA協(xié)處理器平臺是基于計算機網(wǎng)絡這個平臺展開,在分布式技術的理念之下,將具有不同功能的專用FPGA協(xié)處理器進行整合構建起來的,本文中的FPGA協(xié)處理器平臺能夠使得用戶通過PC端的瀏覽器發(fā)出控制命令,啟用AES加解密協(xié)處理器和存儲協(xié)處理器來完成數(shù)據(jù)加解密和存儲功能。該平臺的構建是為了能夠將計算機的一些處理任務進行轉移,并通過硬件對其進行任務處理,一方面是能夠分擔計算機的工作任務,提高其處理性能,另一方面是能夠采用FPGA協(xié)處理器進行任務的分布式并行處理,提高整體的工作效率,以期發(fā)揮FPGA協(xié)處理器平臺的最大處理能力。
【關鍵詞】：FPGA協(xié)處理器 分布式技術 網(wǎng)絡通信 AES算法
【學位授予單位】：云南大學
【學位級別】：碩士
【學位授予年份】：2015
【分類號】：TP332;TN791
【目錄】：

• 摘要3-4
• Abstract4-6
• 第一章 緒論6-14
• 1.1 研究背景6-7
• 1.2 FPGA協(xié)處理器技術的現(xiàn)狀7-9
• 1.3 分布式技術的現(xiàn)狀9-11
• 1.4 論文的主要工作及創(chuàng)新點11-12
• 1.5 本文的章節(jié)結構及內容安排12-14
• 第二章 FPGA協(xié)處理器平臺的構建14-22
• 2.1 FPGA協(xié)處理器平臺的總體設計14-16
• 2.2 協(xié)處理器設計16-18
• 2.3 通信模塊設計18-21
• 2.4 小結21-22
• 第三章 AES加/解密協(xié)處理器22-42
• 3.1 AES加密算法原理22-30
• 3.1.1 算法結構總述22-25
• 3.1.2 AES算法的基本變換25-28
• 3.1.3 密鑰擴展算法28-30
• 3.2 AES解密算法原理30-34
• 3.3 AES加/解密組件的設計34-41
• 3.4 小結41-42
• 第四章 FPGA存儲協(xié)處理器42-50
• 4.1 分布式存儲原理42-43
• 4.2 FPGA存儲協(xié)處理器的設計實現(xiàn)43-49
• 4.3 小結49-50
• 第五章 系統(tǒng)測試50-56
• 5.1 AES組件仿真50-52
• 5.2 加密功能測試52-53
• 5.3 存儲功能測試53-55
• 5.4 小結55-56
• 第六章 總結與展望56-58
• 6.1 總結56
• 6.2 后期研究計劃及展望56-58
• 參考文獻58-60
• 攻讀碩士學位期間取得的學術成果60-62
• 致謝62

【參考文獻】

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  本文關鍵詞：一種分布式FPGA協(xié)處理器平臺的研究與設計，由筆耕文化傳播整理發(fā)布。

本文編號：252534