本文關(guān)鍵詞：基于VMM的FPGA軟件可重用驗(yàn)證平臺

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【摘要】：傳統(tǒng)的驗(yàn)證平臺編寫復(fù)雜,且難以在不同設(shè)計(jì)之間重用。采用System Verilog支持的VMM驗(yàn)證方法學(xué),并結(jié)合帶約束的隨機(jī)驗(yàn)證和覆蓋率驅(qū)動的驗(yàn)證技術(shù),構(gòu)建可重用驗(yàn)證平臺,完成被測FPGA軟件的驗(yàn)證。與直接測試方法相比,該驗(yàn)證平臺不僅能夠有效提高驗(yàn)證效率,而且在模塊級和系統(tǒng)級驗(yàn)證過程中,能夠重用該驗(yàn)證平臺或驗(yàn)證組件。
【作者單位】： 海軍駐天津八三五七研究所軍事代表室;天津津航計(jì)算技術(shù)研究所;
【關(guān)鍵詞】： SystemVerilog VMM 可重用 驗(yàn)證平臺
【分類號】：TN791
【正文快照】： 1引言隨著集成電路設(shè)計(jì)技術(shù)以及武器裝備的信息化、數(shù)字化程度的不斷提高,百萬門級乃至千萬門級的可編程邏輯器件在軍用電子產(chǎn)品中被廣泛采用,在型號研制項(xiàng)目中所起的作用也變的更為關(guān)鍵,相應(yīng)代碼設(shè)計(jì)問題也大量的出現(xiàn)。目前,可編程邏輯器件驗(yàn)證主要使用傳統(tǒng)的驗(yàn)證方法,它需要

【相似文獻(xiàn)】

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6 iJ淑媚;灻斐章;周佩廷;R壭憔，

本文編號：816089