本文關鍵詞：一種帶有亞穩(wěn)態(tài)消除電路的TDC設計方案

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【摘要】：時間間隔測量技術在原子物理、激光測距、定位定時等方面有著重要的應用,因此,高精度的時間數(shù)字轉換電路TDC(Time-to-Digital Converter)在科學研究和工程實踐中扮演著重要的角色;本次提出的TDC設計方案功耗為400μW,工作在512MHz,實現(xiàn)了250 ps的測量精度和1μs的測量范圍,但是TDC在進行時間間隔測量量化時往往受到亞穩(wěn)態(tài)制約。通過加入相位判斷邏輯,TDC的積分非線性降低到0.25 LSB,而差分非線性降低到了0.5 LSB,可以完全消除TDC量化時間間隔時遇到的亞穩(wěn)態(tài)問題。
【作者單位】： 電子科技大學電子薄膜與集成器件國家實驗室;西南技術物理研究所;
【關鍵詞】： 科學研究和工程實踐 亞穩(wěn)態(tài)消除 相位判斷邏輯 時間間隔測量 時間數(shù)字轉換電路
【基金】：中央高校基本科研業(yè)務費項目(ZYGX2014J024) 國家自然科學基金項目(61404025)
【分類號】：TN702
【正文快照】： 時間間隔測量技術在原子物理、激光測距、定位定時等領域有著廣泛的應用。此外,在工業(yè)控制以及視覺識別等領域中,時間間隔測量作為一種重要的鑒別和探測手段,對精度的要求非常嚴格,甚至達到了皮秒量級。因此,高精度的TDC電路有著重要的作用。2008年,Minjae Lee[2],Asad A Abid

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