發(fā)布時間：2017-08-21 22:40

  本文關(guān)鍵詞：基于ESL的華睿2號SoC系統(tǒng)級架構(gòu)設計

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【摘要】：華睿2號是我國自主研發(fā)的一款8核微處理器,基于CMOS 40nm工藝設計,片內(nèi)集成8核DSP、AXI總線以及PCIE/DDR3等多種高速接口的大規(guī)模片上系統(tǒng)芯片(So C).鑒于華睿2號設計復雜,需使用電子系統(tǒng)級(ESL)解決方案,確定So C級架構(gòu).ESL設計方法學已被越來越多的復雜So C設計所采納,利用可裁剪的TLM建模方法快速搭建系統(tǒng),進行系統(tǒng)級驗證,探索不同架構(gòu)設計對系統(tǒng)性能的影響,從而尋找最優(yōu)方案.本文利用Synopsys ESL解決方案,創(chuàng)建So C不同的架構(gòu),并在創(chuàng)建的架構(gòu)上運行雷達信號處理典型應用,分析處理時間、總線壓力等架構(gòu)性能,通過優(yōu)劣對比最終確定最優(yōu)架構(gòu).
【作者單位】： 南京電子技術(shù)研究所;
【關(guān)鍵詞】： 華睿號 片上系統(tǒng)芯片 電子系統(tǒng)級 架構(gòu)設計
【基金】：核高基重大專項課題(2012ZX01034-001-002)
【分類號】：TN47
【正文快照】： So C芯片設計需要進行大規(guī)模、深入的系統(tǒng)級仿真,以確保設計的體系架構(gòu)合適均衡.傳統(tǒng)的基于RTL的So C架構(gòu)及性能分析,往往由于RTL設計實現(xiàn)的代碼量大,仿真速度慢,一旦發(fā)現(xiàn)架構(gòu)設計存在性能瓶頸時,必須重新修改架構(gòu)方案,重新編寫RTL代碼,導致迭代次數(shù)增加,迭代周期過長,因此已

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本文編號：715590