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改進(jìn)Cholesky分解算法的設(shè)計與FPGA實現(xiàn)

發(fā)布時間:2022-07-14 09:46
  針對大規(guī)模數(shù)字陣列的空域信號處理以及空時信號處理的要求,提出了一種高速并行的基于Cholesky分解的協(xié)方差矩陣反問題求解算法。相對于其他現(xiàn)有算法,所提算法具有更高的并行度與更低的處理延遲。在算法實現(xiàn)方面,提出了一種基于脈動陣列+反饋環(huán)的矩陣迭代結(jié)構(gòu)來實現(xiàn)該算法,并在現(xiàn)場可編程門陣列(Field Programmable Gate Array,FPGA)平臺上驗證了該結(jié)構(gòu)的有效性。電子設(shè)計自動化(Electronic Design Automatic,EDA)工具的綜合與實現(xiàn)結(jié)果表明,所提算法實現(xiàn)結(jié)構(gòu)具有高并行性、低延遲等優(yōu)勢,尤其在矩陣規(guī)模相對較大時優(yōu)勢明顯。 

【文章頁數(shù)】:5 頁

【文章目錄】:
0 引言
1 算法設(shè)計與實現(xiàn)
    1.1 理論基礎(chǔ)
    1.2 改進(jìn)Cholesky分解算法
    1.3 FPGA實現(xiàn)
2 性能分析
3 結(jié)論


【參考文獻(xiàn)】:
期刊論文
[1]可配置Cholesky分解矩陣求逆的FPGA實現(xiàn)[J]. 胡鐵喬,張毛毛,李陽波.  中國民航大學(xué)學(xué)報. 2017(04)



本文編號:3660894

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