隨著移動終端與硬件算力需求的不斷擴大,采用資源豐富而且開發(fā)周期短的嵌入式SoC成為了硬件設(shè)計的發(fā)展方向,與此同時,多核異構(gòu)、單核升頻等技術(shù)的推廣和應(yīng)用也對系統(tǒng)總線頻率、延遲等一系列指標提出了很高的要求。RapidIO總線作為一種引腳少、頻率高、延遲低的互連技術(shù)有效解決了以上問題,而如何高效地驗證和集成RapidIO成為了系統(tǒng)互連的關(guān)鍵。目前設(shè)計中使用的IP功能復雜度越來越高,特性也越來越多,采取合適的驗證方法,合理提煉驗證的IP功能點并分類顯得尤為重要。然而一般第三方供應(yīng)商并不提供針對RapidIO獨立的驗證環(huán)境,包括完整的測試用例、分析器和硬件仿真模型,因此在以往的技術(shù)上深入研究可以減少二次開發(fā)的成本消耗并且提高驗證效率。本論文基于上述背景進行研究,在分析總線協(xié)議的基礎(chǔ)上提出并設(shè)計了一種基于通信SoC的RapidIO驗證平臺方案,該驗證方案可有效提高RapidIO驗證效率,縮短驗證時間,其層次化的結(jié)構(gòu)保證了驗證平臺具有一定的復用性、可維護性和可讀性。論文首先具體地分析了RapidIO的基本傳輸協(xié)議、端口、功能模塊的劃分、操作類型以及包格式。AMBA總線的信號與操作狀態(tài)。研究了常見的幾... 

【文章來源】：西安電子科技大學陜西省 211工程院校 教育部直屬院校

【文章頁數(shù)】：86 頁

【學位級別】：碩士

【部分圖文】：

BFM產(chǎn)生NREAD操作

BFM產(chǎn)生NWRITE操作

圖 3.11 BFM 遍歷產(chǎn)生 NWRITE_R 操作BFM SWRITE 操作的寫操作的配置過程為：檢測鏈路狀態(tài)，在 IREQ 接口產(chǎn)生SWRITE(ftype=6)請求。SWRITE 操作在數(shù)據(jù)載荷上與 NWRITE 和 NWRITE_R 操作不同，或者說 SWRITE 像簡化了的寫操作。不需要 ireq_byte_en 來定義數(shù)據(jù)載荷那一段有效，因為規(guī)定總線上的數(shù)據(jù)都是雙字有效的。相應(yīng)的包頭信息也很簡單，根據(jù)dword 數(shù)計算操作周期后，由 ireq_sof_n 以及 ireq_eof_n 兩個信號決定包開始和結(jié)束，這直接確定了包的長度。初始地址同樣聲明在 ireq_addr 總線上。傳輸優(yōu)先級與傳輸中止信號的聲明同 NWRITE。圖 3.12 為 BFM 產(chǎn)生 SWRITE 操作的波形圖。

【參考文獻】：
期刊論文
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碩士論文
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本文編號：3477275