本文選題：超高頻射頻識別 + 標簽��； 參考：《微電子學》2017年03期

【摘要】：無源標簽的識別距離主要與功耗有關,因此降低標簽的功耗成為設計者重點關注的目標。采用門控時鐘、算法優(yōu)化、行波計數(shù)器、低閾值電壓以及功耗管理單元等低功耗技術(shù),對基于ISO/IEC 18000-6C標準協(xié)議的超高頻RFID標簽芯片的數(shù)字電路進行功耗優(yōu)化。仿真結(jié)果顯示,在1.8V工作電壓下,電路功耗為12.3μW,與優(yōu)化前電路相比,功耗優(yōu)化率達43.6%,有效降低了標簽數(shù)字電路的功耗。
[Abstract]:The recognition distance of passive tags is mainly related to power consumption, so reducing tag power consumption has become the focus of attention of designers. The digital circuit of UHF RFID tag chip based on ISO/IEC 18000-6C standard protocol is optimized by using low-power techniques such as gated clock, algorithm optimization, traveling wave counter, low threshold voltage and power management unit. The simulation results show that the power consumption of the circuit is 12.3 渭 W at 1.8 V operating voltage. Compared with the circuit before optimization, the power optimization rate is 43.6, which effectively reduces the power consumption of the tag digital circuit.
【作者單位】： 廈門大學嘉庚學院;
【基金】：國家自然科學基金資助項目(61301096)
【分類號】：TN79;TP391.44

【參考文獻】

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【共引文獻】

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【二級參考文獻】

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本文編號：1889430