本文關鍵詞：高線性度電流�；祛l器及電流�？勺冊鲆娣糯笃鞯脑O計　出處：《東南大學》2015年碩士論文　論文類型：學位論文

  更多相關文章： 電流�；祛l器 動態(tài)偏置 電流�？勺冊鲆娣糯笃� 有源電阻 直流失調消除

【摘要】：隨著模擬廣播的數(shù)字化發(fā)展,研究兼容基于全球數(shù)字廣播(DRM, Digital Radio Mondiale)與數(shù)字音頻廣播(DAB, Digital Audio Broadcasting)兩種廣播標準的接收機芯片將極大地提升我國在無線通信芯片的地位,具有重大意義。DRM/DAB接收機芯片架構為兩次變頻低中頻結構,從第二中頻混頻器開始將電壓信號轉換為電流信號。本文研究的內容是應用于DRM/DAB接收機的第二中頻CMixer(Currrent-mode Mixer)即電流�；祛l器和CPGA(Current-Mode Programmable Gain Amplifier)即電流模數(shù)字可編程增益放大器電路。CMixer的輸入為35.452MHz的第一中頻電壓信號,本振信號為37.5MHz電壓信號,輸出為2.048MHz第二中頻電流信號�；祛l器采用動態(tài)偏置跨導將電壓信號轉為電流信號,然后經過無源開關混頻器混頻,最后經過電流模放大器推動輸出。其中無源開關級本振偏置為動態(tài)偏置結構,克服電壓、工藝角、溫度的影響。CPGA的輸入輸出信號均為電流信號,中心頻率為2.048MHz,帶寬為1.536MHz。本文的電流放大采用電流模技術,采用電流求和網絡實現(xiàn)電流增益。直流失調消除電路抑制直流增益,減少電路的失配帶來的不穩(wěn)定因素。采用有源電阻代替無源電阻,減少版圖面積。數(shù)字控制邏輯采用譯碼器譯碼,減少測試焊盤數(shù)量。兩個模塊電路均采用中芯國際SMIC 0.18μm RFCMOS工藝進行仿真驗證,并進行了流片、測試,測試結果基本滿足設計要求。同時,分析了測試結果,對進一步工作提出了建議。
[Abstract]:With the development of digital analog broadcasting, digital broadcasting based on global compatibility study (DRM Digital, Radio Mondiale) and digital audio broadcasting (DAB Digital, Audio Broadcasting) receiver chip two broadcast standard will greatly enhance China's position in the wireless communication chip,.DRM/DAB receiver chip architecture is of great significance for two times frequency low frequency the structure, converting the voltage signal to current signal from the beginning of the second frequency mixer. The content of this paper is second if CMixer is applied to the DRM/DAB receiver (Currrent-mode Mixer) is the current mode mixer and CPGA (Current-Mode Programmable Gain Amplifier) is a digital input current mode programmable gain amplifier circuit.CMixer for the first intermediate frequency voltage signal of 35.452MHz. The vibration signal is 37.5MHz voltage signal, the output for the 2.048MHz second frequency mixer using current signal. Dynamic bias voltage signal to current transconductance signal, and then through the passive switch mixer mixing, after the current mode amplifier to drive output. The passive switch level oscillator bias for the dynamic bias voltage, overcome the influence of temperature, process angle,.CPGA input and output signal to current signal, the center frequency is 2.048MHz, bandwidth for the current 1.536MHz. amplification using the current mode, the current implementation of the current gain summing network. DC offset cancellation circuit to suppress DC gain, reduce instability circuit mismatch. The resistance of the active instead of passive resistance, reduce the layout area. The digital control logic decoder, reduce the test pad number two. A module circuit uses SMIC SMIC 0.18 m RFCMOS process simulation, and implemented, tested, the test results satisfy the design requirements. At the same time, the test results were analyzed and suggestions for further work were put forward.

【學位授予單位】：東南大學
【學位級別】：碩士
【學位授予年份】：2015
【分類號】：TN722;TN773

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本文編號：1373423