本文關(guān)鍵詞：高速LVDS信號(hào)接收及基于FPGA的串并轉(zhuǎn)換的設(shè)計(jì)

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【摘要】：主要介紹高速LVDS差分信號(hào)轉(zhuǎn)單端信號(hào)接收模塊的設(shè)計(jì),通過TI公司的SN65LVDS386芯片,接收差分信號(hào)并轉(zhuǎn)換為單端信號(hào),并基于FPGA實(shí)現(xiàn)串行數(shù)據(jù)轉(zhuǎn)換為并行數(shù)據(jù)。
【作者單位】： 華中光電技術(shù)研究所—武漢光電國(guó)家實(shí)驗(yàn)室;
【分類號(hào)】：TN791
【正文快照】： 1引言隨著信息技術(shù)的發(fā)展,數(shù)據(jù)量越來越大。低壓差分信號(hào)傳輸技術(shù)(Low VoltageDifferential Signaling,LVDS)是一種滿足當(dāng)今高速數(shù)據(jù)傳輸應(yīng)用的新型技術(shù),它使得信號(hào)能在差分PCB線對(duì)或平衡電纜上以幾百兆bps的速率傳輸,其低壓幅和低電流驅(qū)動(dòng)輸出實(shí)現(xiàn)了低噪聲和低功耗。在后端需

【相似文獻(xiàn)】

中國(guó)期刊全文數(shù)據(jù)庫 前4條

1 王朔,李剛,于學(xué)敏;基于CPLD的串并轉(zhuǎn)換和高速USB通信設(shè)計(jì)[J];單片機(jī)與嵌入式系統(tǒng)應(yīng)用;2002年05期

2 付秀蘭;孫立宏;;基于65nm CMOS工藝的高速串并轉(zhuǎn)換電路設(shè)計(jì)[J];中國(guó)集成電路;2012年04期

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中國(guó)碩士學(xué)位論文全文數(shù)據(jù)庫 前1條

1 賈小燕;在FPGA中利用SoftSerDes技術(shù)實(shí)現(xiàn)信號(hào)串并轉(zhuǎn)換的研究[D];北京郵電大學(xué);2008年

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本文編號(hào)：1242002